千葉大学 大学院工学研究科・工学部


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難波 一輝
ナンバ カズテル
Kazuteru Namba
情報処理工学領域
情報システム基盤分野
准教授
情報科学専攻
知能情報コース
情報画像学科
工学部1号棟4階411号室
043-290-3255
043-290-3305
namba@
(@マーク以下にfaculty.chiba-u.jpと入力してください。)
http://www.icsd2.tj.chiba-u.jp/~namba/
1997.3 東京工業大学工学部卒
1999.3 同大学院情報理工学研究科修了
2002.3 同博了、博士(工学)
2002.11 千葉大学工学部助手
2007.4 同大学院融合科学研究科
2014.11 現職
(2012.10-2013.8 米国Northeastern University客員研究員)
電子情報通信学会、IEEE、情報処理学会
計算機システム、フォールトトレラントシステム
・VLSI の高信頼化設計
・VLSI のテスト容易化設計

製造したVLSIは、そのままではとても信頼して使用できる代物ではない。故障もすれば、製造過程で既に欠陥品が混じっていることも決して少なくない。そのため、高信頼化技術を用いることにより、VLSIの信頼性を高める必要がある。高信頼化技術は設計生産性向上技術、微細化高集積化技術などと並び、今、産業界から強く求められている技術の一つであり、VLSI の高信頼化技術を研究することの社会貢献は大きいと言える。
[1] Kazuteru Namba and Fabrizio Lombardi, "Parallel decodable multi-level unequal burst error correcting codes for memories of approximate systems," IEEE Trans. Comput.
[2] Kazuteru Namba and Fabrizio Lombardi, "Single multiscale-symbol error correction codes for multiscale storage systems," IEEE Trans. Comput.
[3] Kazuteru Namba and Fabrizio Lombardi, "High-speed parallel decodable non-binary single-error correcting (SEC) codes," IEEE Trans. Device Mater. Reliab., Vol. 16, No. 1, pp.30-37, Mar. 2016.
[4] Wei Wei, Kazuteru Namba, Yong-Bin Kim and Fabrizio Lombardi, "A Novel Scheme for Tolerating Single Event/Multiple Bit Upsets (SEU/MBU) in Non-Volatile Memories, " IEEE Trans. Comput., vol. 65, no. 3, pp.781-790, Mar. 2016.
[5] Ri Cui and Kazuteru Namba, "A Calibration Technique for DVMC with Delay Time Controllable Inverter," IPSJ Trans. Syst. LSI Des. Method, Vol.9, pp.30-36, Feb. 2016.
[6] Kentaroh Katoh and Kazuteru Namba, "TDC-Based Maximum Delay Sensor for On-Line Timing Error Detection in Logic Block of VLSIs," Sens. and Mater., vol. 27, no. 10, pp.933-943, Nov. 2015.
[7] Kazuteru Namba and Fabrizio Lombardi, "Parallel decodable two-level unequal burst error correcting codes," IEEE Trans. Comput., Vol. 64, No. 10, pp. 2902-2911, Oct. 2015.
[8] Kazuteru Namba and Fabrizio Lombardi, "Non-binary Orthogonal Latin Square Codes for a Multilevel Phase Charge Memory (PCM)," IEEE Trans. Comput., Vol. 64, No. 7, pp.2092-2097, Jul. 2015.
[9] Kazuteru Namba and Fabrizio Lombardi, "A single and adjacent symbol error correcting parallel decoder for Reed-Solomon codes," IEEE Trans. Device Mater. Reliab., Vol. 15, No. 1, pp.75-81, Mar. 2015.
[10] 崔 日, 難波 一輝, "半導体集積回路及び遅延測定回路," 特願2015-044113号, PCT/JP2016/001185.
計算機システム入門
集積システム設計
情報画像実験II (論理回路)
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